{"id":14748,"date":"2023-12-18T12:58:07","date_gmt":"2023-12-18T11:58:07","guid":{"rendered":"https:\/\/telecomkh.info\/?p=14748"},"modified":"2023-12-18T12:58:07","modified_gmt":"2023-12-18T11:58:07","slug":"el-bsc-presenta-sargantana-la-nueva-generacion-de-los-primeros-chips-de-codigo-abierto-disenados-en-espana","status":"publish","type":"post","link":"https:\/\/telecomkh.info\/?p=14748","title":{"rendered":"El BSC presenta Sargantana, la nueva generaci\u00f3n de los primeros chips de c\u00f3digo abierto dise\u00f1ados en Espa\u00f1a"},"content":{"rendered":"<p><strong>La tercera generaci\u00f3n de procesadores de la familia Lagarto, dise\u00f1ados \u00edntegramente en el BSC, supone un paso adelante en el desarrollo de chips europeos de altas prestaciones<\/strong><\/p>\n<p>El Barcelona Supercomputing Center \u2013 Centro Nacional de Supercomputaci\u00f3n (BSC-CNS) ha presentado el nuevo chip Sargantana, la tercera generaci\u00f3n de procesadores de c\u00f3digo abierto dise\u00f1ados \u00edntegramente en el BSC. El desarrollo de Sargantana es un paso adelante crucial para reforzar la posici\u00f3n de liderazgo del BSC en la investigaci\u00f3n en tecnolog\u00edas de computaci\u00f3n de c\u00f3digo abierto RISC-V en Europa.<br \/>\nSargantana (nombre de lagartija en aragon\u00e9s y catal\u00e1n) constituye la tercera generaci\u00f3n de los procesadores Lagarto, los primeros chips de c\u00f3digo abierto (open source) desarrollados en Espa\u00f1a, en el marco del proyecto DRAC (Designing RISC-V-based Accelerators for next generation Computers), y es uno de los chips de c\u00f3digo abierto m\u00e1s avanzados de Europa a nivel acad\u00e9mico. El nuevo Sargantana presenta una mejor prestaci\u00f3n de rendimiento que sus dos predecesores -Lagarto Hun (2019) y DVINO (2021)- y es el primer procesador de la familia Lagarto que rompe la barrera del gigahercio en la frecuencia de trabajo.<br \/>\nEl hecho de que el repertorio de instrucciones (ISA) de estos nuevos procesadores sea de c\u00f3digo abierto, y por tanto sin propietario y accesible para todos, reduce la dependencia tecnol\u00f3gica de las grandes corporaciones multinacionales, al permitir la innovaci\u00f3n a trav\u00e9s de la colaboraci\u00f3n de empresas e instituciones sin las limitaciones que implican las arquitecturas propietarias. La arquitectura de hardware libre RISC-V, en la que est\u00e1n basados estos nuevos chips, podr\u00eda suponer una revoluci\u00f3n tecnol\u00f3gica en el mundo del hardware como la que supuso Linux para el mundo del software.<br \/>\n\u201cLa presentaci\u00f3n de Sargantana es un nuevo paso adelante en el desarrollo de tecnolog\u00eda europea basada en RISC-V, un embri\u00f3n del futuro procesador europeo de altas prestaciones. Este hardware libre ser\u00e1 vital para garantizar la soberan\u00eda tecnol\u00f3gica y mantener la competitividad industrial europea, y consolida el papel del BSC como pionero en Europa en la introducci\u00f3n del c\u00f3digo abierto para el dise\u00f1o de chips\u201d, ha asegurado el director del BSC, Mateo Valero.<br \/>\nLa Uni\u00f3n Europea identific\u00f3, en 2017, la carencia de hardware propio como una de las principales vulnerabilidades, por el riesgo de espionaje industrial que supone una dependencia excesiva de los chips dise\u00f1ados y producidos fuera de Europa, especialmente en Estados Unidos, Taiw\u00e1n, China, Jap\u00f3n y Corea del Sur. Entonces, el BSC recibi\u00f3 el encargo de la UE de liderar el desarrollo cient\u00edfico de los futuros chips europeos para dotar al mercado de una alternativa libre y local, apta para la computaci\u00f3n de altas prestaciones, la inteligencia artificial, el sector del autom\u00f3vil y el internet de las cosas.<\/p>\n<p><strong>Trabajo conjunto coordinado por el BSC<\/strong><br \/>\nEn el desarrollo de Sargantana han participado investigadores de otras universidades y centros de investigaci\u00f3n como el Centro de Investigaci\u00f3n en Computaci\u00f3n del Instituto Polit\u00e9cnico Nacional de M\u00e9xico (CIC-IPN), el Centro Nacional de Microelectr\u00f3nica (CNM-CSIC), la Universitat Polit\u00e8cnica de Catalunya (UPC), la Universitat Aut\u00f2noma de Barcelona (UAB), la Universitat de Barcelona (UB) y la Universitat Rovira i Virgili (URV).<br \/>\nEl proyecto lo ha coordinado el investigador del BSC Miquel Moret\u00f3, quien ha subrayado las ventajas del dise\u00f1o de semiconductores de c\u00f3digo abierto para permitir la colaboraci\u00f3n de empresas e instituciones acad\u00e9micas de todo el mundo. \u201cEl nuevo chip Sargantana est\u00e1 disponible para todos de forma gratuita, permitiendo una nueva era de innovaci\u00f3n de procesadores a trav\u00e9s de la colaboraci\u00f3n abierta en la que cualquier persona de cualquier lugar podr\u00e1 beneficiarse de la tecnolog\u00eda RISC-V\u201d, ha afirmado.<br \/>\nMoret\u00f3 ha precisado que Sargantana es un chip experimental, un prototipo de investigaci\u00f3n que permitir\u00e1 probar aplicaciones con tecnolog\u00eda RISC-V y profundizar en el conocimiento, pero todav\u00eda no est\u00e1 pensado para utilizarse en ordenadores ni en otros dispositivos. \u00abEstamos desarrollando una tecnolog\u00eda que permitir\u00e1 en un futuro a Espa\u00f1a y Europa dise\u00f1ar sus propios procesadores cada vez m\u00e1s competitivos, adem\u00e1s de formar a los futuros profesionales de un sector que sin duda aportar\u00e1 gran valor a la cadena productiva\u00bb, ha a\u00f1adido Moret\u00f3, que ha destacado el esfuerzo conjunto de Catalu\u00f1a, Espa\u00f1a y Europa para tener tecnolog\u00eda europea hecha en Barcelona y formar ingenieros en este campo.<\/p>\n<p><strong>Liderazgo europeo en RISC-V<\/strong><br \/>\nEste objetivo se alinea con la idea se\u00f1alada por Mateo Valero de convertir a Barcelona en un polo de referencia internacional en el dise\u00f1o de procesadores. \u00abTenemos el talento, el conocimiento tecnol\u00f3gico y el entorno cient\u00edfico necesarios para que Barcelona y su entorno pueda competir con cualquier instituci\u00f3n o regi\u00f3n del mundo y convertirse en un Design Valley que impulse la creaci\u00f3n de empresas y nuevos puestos de trabajo\u00bb, ha indicado Valero.<br \/>\nEl proyecto Sargantana ha contado con financiaci\u00f3n del Proyecto Estrat\u00e9gico de Transformaci\u00f3n para el sector de los semiconductores, el conocido como PERTE Chip, el de mayor inversi\u00f3n de todos los proyectos de transformaci\u00f3n industriales aprobados por el Gobierno espa\u00f1ol, as\u00ed como de fondos europeos del Programa Operativo FEDER de Catalu\u00f1a 2014-2020, con el apoyo de la Generalitat de Catalunya.<br \/>\nEl acto de presentaci\u00f3n de Sargantana se ha celebrado en las instalaciones del BSC en Barcelona en el marco de la primera jornada de la Spanish Open Hardware Alliance (SOHA), asociaci\u00f3n que agrupa a universidades y centros de investigaci\u00f3n espa\u00f1oles con el objetivo de impulsar la investigaci\u00f3n en el \u00e1rea de Tecnolog\u00eda y Arquitectura de Computadores en abierto, contribuyendo as\u00ed a la formaci\u00f3n de talento que permita la creaci\u00f3n de puestos de trabajo de alta calidad.<\/p>\n<p><span style=\"color: #999999;\"><em>Arriba, imagen cortes\u00eda de BSC<\/em><\/span><\/p>\n","protected":false},"excerpt":{"rendered":"<p>La tercera generaci\u00f3n de procesadores de la familia Lagarto, dise\u00f1ados \u00edntegramente en el BSC, supone un paso adelante en el desarrollo de chips europeos de altas prestaciones El Barcelona Supercomputing Center \u2013 Centro Nacional de Supercomputaci\u00f3n (BSC-CNS) ha presentado el nuevo chip Sargantana, la tercera generaci\u00f3n de procesadores de c\u00f3digo abierto dise\u00f1ados \u00edntegramente en el &hellip; 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